原创 Xilinx 原語的具體實現方式大揭祕

今天發現了一個祕密,不知稱爲祕密是否恰當。之前使用Xilinx的原語都是直接調用的,不知到其具體的實現方式,使用的時候就感覺莫名其妙的。今天突然發現只要是原語都可以在Vivado的安裝目錄下找到其對應的.v文件。如果你Vivado的安裝在

原创 IC基礎(六):3x3脈動陣列計算矩陣相乘

本文是在看了一個博客之後才知道怎麼做的,就是這個博客FPGA脈動陣列的設計,可惜的是這個博客是轉載的,原博客已經找不到了。但是其介紹的還是很詳細的,在次基礎上我完成了自己的的3*3脈動陣列的設計。本文後面會給出一個PPT文檔,也是

原创 虛擬機下的ubuntu全屏顯示

1、在虛擬機菜單欄下的虛擬機——>安裝VMTools,這會下載一個安裝包 2、將上面下載的安裝包複製到桌面,使用命令解壓 tar -xzvf 安裝包名字 3、安裝解壓出來的一個文件 ./vmware-install.pl

原创 zynq中斷:共享外設中斷之AXI GPIO 中斷

摘要: 本能篇主要講一下AXI GPIO 中斷,AXI GPIO 中斷也是共享外設中斷的一種。本講和上一講說的中斷很像,區別就是AXI GPIO 中斷需要AXI GPIO核。 本章也是使用PL邏輯產生一組方波信號來做中斷信號,方波

原创 小白也能開始VCS+Verdi的旅程

轉載自:小白也能開始VCS+Verdi的旅程 前言 隨着工藝發展,芯片集成度越來越高,內部能達到幾千萬甚至上億的邏輯單元以及功能模塊。無論是FPGA RD還是IC RD,在做複雜RTL開發的時候,都不可能保

原创 乘法器設計(一):基於移位相加的乘法器設計

  在硬件電路中,常採用二進制乘法器,因此只講二進制乘法器的原理。二進制乘法原理與十進制乘法原理類似,都是將乘數的每一位和被乘數相乘,除此之外,二進制乘法還有其自身的特點,這對於硬件設計極爲關鍵。 二進制乘法器可以分爲有符號數乘法和無符號

原创 Linux基礎(一):Vim編輯器的源代碼安裝方式

說明:本次使用的是源碼安裝方式,通過Vim的源碼安裝也可以學習在Linux下如何使用源碼進行軟件的安裝。 下載vim源碼 解壓源碼 cd ~ mkdir temp #把源碼拷貝進temp cp xxxxx /ho

原创 從零開始VCS+Verdi 安裝過程

轉載:轉載自:從零開始VCS+Verdi 安裝過程 主要參考:VCS+Verdi 安裝及破解過程(CentOS7)-----FPGA開發 想要一個純淨的系統,所以在虛擬機上直接重新安裝了空白的Ubuntu 16.04。然後(⊙﹏⊙

原创 Linux 下遠程使用ssh遠程登陸另一臺主機並執行命令

工具:expext expect 是什麼,怎麼用? expect是一個免費的編程工具語言,用來實現自動或者交互式任務通信,無需人爲的干預。它是一門腳本語言,所以也與要自己的解釋器,所以也必須安裝解釋器。 在Linux安裝: sud

原创 Xilinx COE文件生成

一、COE文件格式 舉個例子: 這是一個完整的COE文件。 第一行: MEMORY_INITIALIZATION_RADIX=16;  表示的是幾進制數據。   第二行: MEMORY_INITIALIZATION_VECTOR=

原创 乘法器設計(二):基於ROM的乘法器設計

乘法器的另一種實現思想是採用ROM的方式,即將被乘數和乘數連接起來拼成地址,把兩者所有可能的乘積按照地址號存放在ROM的地址空間中,兩個數相乘時,根據兩者構成的地址從ROM索取乘積結果。 首先,我們來看看爲啥這樣是可行的。我們會有一個疑問

原创 always@(posedge clk)時序賦值延遲一個週期

前幾天是問了我一個小問題,我總結關鍵點如下: 情形一: always@(posedge clk) begin if(ce == 1'b1 && ready == 1'b1) w_en <= 1'b1; else w_e

原创 verdi如何顯示波形的所有值而不忽略高位的零

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原创 永久修改PATH環境變量的幾種辦法 永久修改PATH環境變量的幾種辦法

轉載:https://blog.csdn.net/weixin_42155195/article/details/80689814 永久修改PATH環境變量的幾種辦法 查看PATH:echo $PATH以添加mongod

原创 i386 與amd64到底誰個什麼玩意?

簡單的來講,這兩個表示安裝包是幾位的。i386就是32位的,amd64就是64位的。他們既可以安裝在intel的cpu上,也可以安裝在AMD的CPU上。我就是因爲沒注意這個,就又重新安裝了一遍Ubuntu.