原创 相機鏡頭選取
1、物距、像距、焦距之間的關係 認爲物距遠遠大於像距和焦距，近似認爲焦距 f 等於相距 v，都以焦距 f 作爲計算 2、鏡頭的焦距(f )、物距（u）、CCD芯片尺寸、物體尺寸、CCD像元尺寸與設計要求分辨率（設計要達到的指標：每個像元
2020-07-01 00:56:00
原创 Testbench讀取文本文件函數$readmemb測試
$readmemb讀取二進制文本 $readmemh讀取十六進制文本 txt文件：https://pan.baidu.com/s/1_KhzGnSqCSXrzT50h38UZA 程序： module sin ( input [1
2020-06-30 23:39:15
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原创 verilog一些語法
1、邏輯移位與算術移位 右移位數不變，左移擴充位數 邏輯移位：>>,<<，不考慮符號 reg [7:0] a ,b; a=8'b1100_1101; b= (a >>1); b :8'b0110_0110 算術移位：>>>,<<<,考
2020-06-30 23:39:14
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原创 PS_爲新建圖層添加背景色
方法1： 將 <設置背景色> 調整爲想要的背景顏色 選中相應的圖層 Ctrl+Backspace 方法2： 將 <設置前景色> 調整爲想要的背景顏色 選中相應的圖層 選中<油漆桶工具>，點擊圖片
2020-06-30 23:39:14
原创 FPGA/IC相關詞彙縮寫意義
DC（Design Compiler）：邏輯綜合 DFT（Design For Testability）： 可測試性技術 STA（Static Timming Analysis）：靜態時序分析簡稱
2019-07-30 07:04:43
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原创 CPU五級流水線
取指： 指令取指（InstrucTIon Fetch）是指將指令從存儲器中讀取出來的過程。 譯碼： 指令譯碼（InstrucTIon Decode）是指將存儲器中取出的指令進行翻譯的過程。經過譯碼之後得到指令需要的操作數寄存器索引，可以使
2019-07-30 07:04:43
原创 格雷碼下的 fifo空滿判斷
使用gray碼進行對比，如何判斷“空”與“滿” 使用gray碼解決了一個問題（降低亞穩態），但同時也帶來另一個問題，即在格雷碼域如何判斷空與滿。 對於“空”的判斷依然依據二者完全相等(包括MSB)； 而對於“滿”的判斷，如下
2019-07-30 07:04:43
原创 oc od ttl cmos
1、TTL-OC ttl不能線與 2、MOS-OD OD門 ：基極b => 柵極g 集電極c => 漏極d (一般作爲OC-OD的輸出端） 發射極e
2019-07-05 07:39:18
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原创 CORDIC操作流程
舉例： 1、假設在xy座標系中有一個點P1（x1，y1）已知，將P1點繞原點旋轉θ角後得到點P2（x2，y2），求P2（x2，y2）座標。 如圖： 於是可以得到P1和P2的關係。 x2 = x1cosθ – y1sinθ = cos
2019-07-03 08:11:49
原创 有關兩級觸發器進行異步時鐘域同步
兩級觸發器可防止亞穩態傳播的原理： 一位同步器.png 假設第一級觸發器的輸入不滿足其建立保持時間，它在第一個脈衝沿到來後輸出的數據就爲亞穩態，那麼在下一個脈衝沿到來之前，其輸出的亞穩態數據在一段恢復時間後必須穩定下來，而且穩定的數據
2019-07-03 08:11:49
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原创 verilog邏輯移位與算術移位
邏輯移位：>>,<<，不考慮符號 reg [7:0] a ,b; a=8'b1100_1101; b= (a >>1); b :8'b0110_0110 算術移位：>>>,<<<,考慮符號位 reg signed [7:0] a
2019-07-03 08:11:48
原创 門控時鐘
時鐘信號的功耗佔系統功耗的很大一部分（40%左右）佔動態功耗的50%以上 使用效果實例： a. 對於一個180nm工藝的芯片：有clock gating和沒有clock gating的結果相比（芯片實測）： a. 功耗節省34%到
2019-07-03 08:11:48
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原创 define-parameter
define，是宏定義，全局有效。則在整個工程都是有效 parameter，參數，可以由調用者修改參數值。 localparam，本地參數，調用者不可修改。
2019-06-23 07:56:46
原创 大疆FPGA開發工程師筆試
作者：zhsjfpga 鏈接：https://www.nowcoder.com/discuss/85430 來源：牛客網 一共是75分鐘的時間，從19:30到20:45，題型如下：（可能分值會有錯誤，實在記不清了） 20個單選： 4
2019-06-11 19:15:40
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