原创 【VHDL】計數器實現2-4-8分頻

計數器實現2-4-8分頻 分頻器：對較高頻率的信號進行分頻，得到較低頻率的信號，本質是計數器 類似於2-4-8分頻的問題有以下兩個特點: 一、二的指數倍 ----------- 二、佔空比爲50% --------

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原创 教你如何刷網課

教你如何刷網課 工具：油猴插件 下載地址 這裏推薦火狐瀏覽器----原因是安裝方便 谷歌瀏覽器就比較麻煩 谷歌安裝步驟 這裏就以火狐瀏覽器做介紹 打開火狐，輸入下載地址（https://www.tampermonkey.

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原创 【VHDL】帶使能端的同步復位的8位寄存器設計

【VHDL】帶使能端的同步復位的8位寄存器設計 程序： library ieee; use ieee.std_logic_1164.all; entity reg8 is port(clk,OE,RES:in std_logic

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原创 【VHDL】分頻器設計要求：25分頻，佔空比爲50%

【VHDL】分頻器設計要求：25分頻，佔空比爲50% 程序` LIBRARY IEEE; USE IEEE.STD_LOGIC_1164.all; entity DIV_25 IS PORT(CLK:IN STD_LOGIC;

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原创 【VHDL】基礎知總結（1）

EDA名詞解釋： EDA:電子設計自動化 CPLD:複雜可編程邏輯器件 FGPA:現場可編輯邏輯門陣列 VHDL:硬件描述語言 ASIC:專用集成電路 ROM：只讀存儲器 RAM：隨機存儲器 PAL：可編程陳列邏輯 PLA：可

2020-06-10 07:05:13

原创 【VHDL】四選一選擇器程序編寫

四選一選擇器程序編寫 程序： library ieee; use ieee.std_logic_1164.all; entity si is port(S0,S1,EN:in std_logic; A:in std_logic

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原创 【VHDL】利用計數器實現20分頻，佔空比爲50%

利用計數器實現20分頻，佔空比爲50% 程序： LIBRARY IEEE; USE IEEE.STD_LOGIC_1164.ALL; --USE IEEE.STD_LOGIC_UNSIGNED.ALL; ENTITY CNT_20

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原创 【VHDL】VHDL實現同步置數，異步復位的D觸發器設計

同步置數，異步復位的D觸發器設計 程序` LIBRARY ieee; USE ieee.std_logic_1164.all; ENTITY D IS PORT (clk,R,S: IN STD_LOGIC; D: IN

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原创 【VHDL】狀態機設計——moore型

例：完成自動售貨機的VHDL設計。要求：有兩種硬幣：1元或5角， 投入1元5角硬幣輸出貨物，投入2元硬幣輸出貨物並找5角零錢。 程序： library ieee; use ieee.std_logic_1164.all; ent

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